四则运算小计算器设计过程实录

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《四则运算小计算器设计过程实录》，副标题：Verilog FPGA数字系统设计入门学习日记，赵然 著，出版社： 北京航空航天大学出版社。

书籍是用文字、图画和其他符号，在一定材料上记录各种知识，清楚地表达思想，并且制装成卷册的著作物，为传播各种知识和思想，积累人类文化的重要工具。

内容简介

四则运算小计算器设计过程实录-Verilog FPGA数字系统设计入门学习日记

本书以日记的形式记录了一个可实现四则运算计算器的设计过程，从而达到学习FPGA 设计的目的。全书共10章，讲述了从设计开始到完成的全过程，其中包括数码管显示、键盘扫描、状态

机等基础模块的设计，以及设计中需要注意的问题等，每一章的最后还有夏宇闻老师对本章内容的点评及给读者的学习建议。希望读者按顺序阅读本书，同时进行实践操作，并与书中的进度保持一致，最终完成整个设计。读者也可以根据自己的想法来实现想要的功能，做到举一反三，以达到好的学习效果。书中使用的硬件为至芯科技的四代开发板、AlteraCycloneIV的芯片，软件为uartusII13．0sp1。

本书可作为电子工程类、自动控制类、计算机类的大学本科高年级学生及研究生设计实验参考用书，亦可供其他工程人员自学与参考。